【jeton界】AI+ZK chaîne publique Polyhedra a déclaré qu'elle avait terminé l'optimisation du cadre Expander la semaine dernière. Les améliorations clés incluent : l'intégration de bout en bout du Prover GPU avec le cadre Expander, le Prover peut désormais passer sans effort entre les modes d'exécution CPU et GPU via des variables d'environnement, réalisant un accélérateur GPU transparent sans configuration supplémentaire ; optimisation des primitives arithmétiques FPGA pour les appareils Versal HBM, y compris les additionneurs et multiplicateurs pour les champs M31Ext3, Goldilocks et BN254, maximisant le débit et minimisant la latence en utilisant une mémoire à bande passante élevée, posant les bases d'une génération de preuve entièrement accélérée par matériel sur FPGA ; tests de référence des noyaux arithmétiques préliminaires pour vérifier la validité fonctionnelle et l'extension du débit.
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ClassicDumpster
· Il y a 1h
Cette vague de prendre les gens pour des idiots, n'est-ce pas ? upup
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GasFeeWhisperer
· Il y a 6h
Est-ce que la vitesse est plus rapide mais la durabilité est mauvaise, ou bien est-ce que la vitesse est plus lente mais la sécurité est mauvaise ?
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PessimisticOracle
· 09-02 03:50
bull ah GPU acceleration, mais je ne sais pas si c'est stable.
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degenwhisperer
· 09-02 03:45
C'est tout pour cette amélioration matérielle ?
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AllInAlice
· 09-02 03:40
Le matériel s'améliore si rapidement, To the moon !
Polyhedra a terminé l'optimisation du cadre Expander, réalisant une accélération GPU et une amélioration des performances FPGA.
【jeton界】AI+ZK chaîne publique Polyhedra a déclaré qu'elle avait terminé l'optimisation du cadre Expander la semaine dernière. Les améliorations clés incluent : l'intégration de bout en bout du Prover GPU avec le cadre Expander, le Prover peut désormais passer sans effort entre les modes d'exécution CPU et GPU via des variables d'environnement, réalisant un accélérateur GPU transparent sans configuration supplémentaire ; optimisation des primitives arithmétiques FPGA pour les appareils Versal HBM, y compris les additionneurs et multiplicateurs pour les champs M31Ext3, Goldilocks et BN254, maximisant le débit et minimisant la latence en utilisant une mémoire à bande passante élevée, posant les bases d'une génération de preuve entièrement accélérée par matériel sur FPGA ; tests de référence des noyaux arithmétiques préliminaires pour vérifier la validité fonctionnelle et l'extension du débit.